小型FBG解調系統中數據采集的實現*

李永倩，李曉菲，張 靜

(1.華北電力大學 電子與通信工程系，河北 保定 071003；2.華北電力大學 蘇州研究院，江蘇 蘇州 215123)

光纖光柵（FBG）傳感器具有抗電磁干擾、耐腐蝕、電絕緣、高靈敏度和低成本等優點[1]，已在土木工程、航空航天、機械制造等領域廣泛用于應變、溫度、振動等參數的測量[2-3]。FBG傳感器是一種波長調制型器件，外界物理量的變化會影響FBG的中心波長值。因此，精確解調FBG波長的變化量是FBG傳感的一項關鍵技術。

FBG解調系統的解調精度取決于FBG信號的采集精度和波長解調算法的高效性[4]。目前，應用最多的是利用數據采集卡采集FBG信號,利用工控機處理FBG信號，導致解調系統體積和功耗大、成本高，不利于實現解調系統的小型化、低功耗和低成本。本文將數字信號處理器（DSP）與復雜可編程邏輯器件（CPLD）技術相結合，設計了用于小型FBG解調儀的數據采集電路，完成了軟硬件調試，實現了FBG傳感信號的有效采集。

1 采集系統整體設計

1.1 性能分析

FBG傳感系統的原理框圖如圖1所示。在F-P濾波器控制器的作用下通過可調諧F-P濾波器[5]，經過3 dB耦合器，將寬帶光源中不同頻帶的光波周期性地分成兩個支路。其中一路入射到參考通道，這一部分的作用是用來對可調諧F-P濾波器進行校準，消除可調諧F-P濾波器腔長漂移對測量精度的影響[6]；另一路入射到FBG傳感通道中，FBG傳感通道中所有光纖布拉格光柵的反射譜必須在F-P濾波器的掃描范圍內,并且各個布拉格光柵的反射譜不能重疊，否則會引起信號串擾。在每個通道中,當F-P濾波器掃描波長與FBG反射波長一致時,光電檢測組件探測到的光能量最大。數據采集系統負責同步采集兩路光電檢測器輸出的電壓信號，并將采集后的數據傳輸給上位機,然后根據電壓峰值坐標與Bragg波長的關系得到反射波長的值,從而達到傳感信號解調的目的。

本傳感系統選用的可調諧Fabry-Perot（F-P）濾波器的掃描頻率設為10 Hz,寬帶光源的光譜寬度為78.2 nm，當波長分辨率達到4.9 pm時,每通道一個采樣周期內采集16 000個點，要求采集系統單通道的采樣率達到160 kS/s以上，并且可以多通道同步采樣。若數據采用16 bit記錄格式，也就是每個點數據量為 2 B，則一個掃描周期內單通道數據量為32 KB，2通道總數據量為 64 KB。

1.2 器件選型

DSP能夠快速實現各種算法,運算精度高[7]；CPLD具有內部延時小、速度快、全部邏輯由硬件完成等優點，接口靈活，被廣泛用于各種時序和邏輯控制電路；由DSP和CPLD組成的最小系統能夠滿足FBG解調系統小型化和低功耗的要求[8]。本系統以DSP+CPLD的硬件結構為開發平臺，DSP選用TMS320F2812(以下簡稱DSP)芯片作為核心處理器[9]，其最大工作頻率可達到150 MHz；CPLD 采用 EPM240T100C5N(以 下簡 稱 CPLD)芯片做邏輯控制元件。A/D轉換芯片采用美國TI公司的ADS8556，它是16位高精度模數轉換器,包括 6個 16 bit模數轉換器（ADCs）；3個獨立的轉換啟動信號分別控制每2個通道的轉換，并且可以2/4/6通道同步采樣[10]；其內部參考電壓可取2.5 V或3.0 V，最大輸入電壓范圍可以達到±12 V；ADS8556可采用并行或串行接口模式，其中，并行接口模式下單通道采樣速率可達到630 kS/s。由于實時采集的數據量比較大，因此采用外部存儲芯片IS61LV25616(以下簡稱SRAM)對DSP的數據存儲空間進行擴展，其容量為256 K×16 bit。

2 采集硬件電路

光電檢測器將兩路光柵信號轉換成電信號后，由于信號強度較弱，信號中包含大量噪聲。首先要對電信號進行放大、濾波處理，然后送入A/D進行采集。采集系統的主要硬件電路如圖2所示。

圖2 采集系統的主要硬件電路

將 DSP的地址線 A0、A1和/CS0分別連接至 CPLD的I/O口上。DSP對/CS0對應的區域地址進行讀操作時，相應片選端和讀信號被置為低電平，地址線上出現所要讀取的地址。CPLD對片選信號/CS0和地址線A0、A1進行地址譯碼，實現對A/D的控制。ADS8556的片選信號/CS、復位信號/RST分別連接到CPLD的I/O口上，通道組A的啟動轉換信號CONV_A連接到CPLD的I/O口上，用來啟動CH1和CH2通道的同步轉換，在轉換期間，CONV_A保持高電平，BUSY信號在轉換期間為高電平，一次轉換結束后BUSY信號返回低電平，將DSP的外部中斷INT1通過CPLD連接至BUSY信號，每次轉換結束后，ADS8556向DSP申請中斷去讀取數據。ADS8556的16位數據線與DSP的16位數據總線直接相連；DSP的讀信號/RD通過CPLD與ADS8556的讀信號/RD相連接，讀取A/D數據時，片選信號/CS先置低，讀信號/RD每變低一次，DSP從16位總線上讀取1個通道的數據，需要讀取2次將2通道數據讀走。

3 采集控制軟件

DSP通過對不同地址的讀取來向CPLD發送指令，CPLD通過片選端和地址線譯碼來執行相應的功能。DSP的軟件流程圖如圖3所示，采用C語言編寫。

圖3 DSP軟件流程圖

首先，對變量以及相應寄存器進行初始化，將2個通道存儲采集數據的數組定義在SRAM對應的存儲空間，以滿足數據存儲容量的要求。本系統每個通道采樣率設為 160 kS/s，采樣周期為 0.1s，即每 6.25 μs保證采樣一次。采集控制的主要流程是：DSP發送啟動轉換指令后，CPLD啟動A/D轉換，在其內部產生一個周期為6.25 μs的定時器，每次定時器時間到，向CONV_A端提供高電平轉換信號，啟動一次A/D轉換，2通道的模擬信號同時開始轉換,ADS8556的轉換時間是1.26 μs。轉換結束后，BUSY信號變低電平產生中斷，DSP進入中斷子程序讀取數據。CPLD根據DSP的讀數據指令控制A/D的片選信號，結合讀信號低電平讀取2次轉換結果，存放在對應的數組中，采樣點數加1，退出中斷，等待下一次轉換結束后，再次讀取數據。當讀取完16 000次數據之后，開始進行數據傳輸。將數據傳輸完之后，將存放數據的數組清零，再次啟動轉換，完成下一個周期的數據采集與存儲。

CPLD采用Verilog語言編寫內部時序和邏輯電路，時序電路主要根據DSP發送來的啟動轉換命令，產生16 000個周期為 6.25 μs的轉換信號 CONV_A，其高電平保持2 μs，保證每次數據轉換完成。在16 000次轉換結束后停止采集，等待DSP的下次啟動轉換指令的到來；邏輯電路主要完成內部管腳之間的連接以及根據地址譯碼來完成對ADS8556的片選信號和讀信號控制。

4 數據采集性能測試

4.1 采集準確性的實驗測試

為了測試本系統采集的準確性和可靠性，完成電路軟硬件調試之后，將FBG傳感系統與采集電路連接起來，FBG傳感通道輸出信號接入采集電路的CH1。

在實驗中，加在F-P濾波器上的掃描電壓范圍為0～18 V，調諧電壓掃描頻率為10 Hz。當在傳感通道中串聯3個FBG傳感器時，由示波器觀測到的F-P掃描電壓和光電檢測器輸出信號的原始波形如圖4所示。

為了觀察采集到的一個周期的數據，實驗時只采集一個周期，即0.1 s的數據，存放在一個長度為16 000的數組中。在CCS3.3環境下運行采集程序，用Graph單通道模式來顯示數組中的數據，CH1通道中的數據波形如圖5所示。

當加在F-P濾波器上的掃描電壓為三角波時，對應掃描正程和返程兩個周期的光柵信號，由示波器觀測到的三角波掃描電壓和傳感通道1的原始波形如圖6所示。運行程序時，相應地采集兩個周期的數據，存放在長度為32 000的數組中，得到的數據波形如圖7所示。

由以上實驗結果可知，本系統能夠準確地采集信號，采集結果無失真。

4.2 同步采集的實驗測試

為了測試采集系統CH1和CH2通道是否實現了同步采集，在FBG傳感通道串聯3個光柵，輸出的信號同時接到采集電路的CH1和CH2，采集一個周期0.1 s的光電信號，圖8所示為在CCS3.3環境下用Graph雙通道模式顯示的2通道的數據波形。

由圖可知，本系統能夠很好地實現2通道數據的同步采集。根據ADS8556的特點，還可以擴展為多個傳感通道的采集系統。

本文設計實現了用于解調FBG傳感信號的數據采集的硬件電路，編寫了采集控制程序，完成了軟硬件調試；將采集系統與FBG傳感系統連接起來進行了性能測試。實驗結果表明，該系統能準確地采集光電信號，滿足FBG解調儀波長分辨率、采集速度的要求。本系統可以擴展多個光柵傳感通道,完成多通道的同步采集；還可以在DSP中編寫波長解調算法，減輕上位機的工作量，最終實現解調系統的小型化。

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