基于可編程計數器74LS161的循環碼計數器設計

馬敬敏

（渤海大學 數理學院，遼寧 錦州121000）

循環碼又稱格雷碼[1-4]，特點是每一位代碼以固定的周期循環，循環碼計數時每次狀態轉換只有一位發生變化，可靠性高。

以可編程同步二進制加法計數器74LS161的狀態輸出量Q3Q2Q1Q0為基礎定義循環碼計數器的狀態輸出量采用邏輯修改的方法進行改變計數規律的設計，可擴展專用集成電路的應用范圍并簡化循環碼計數器的設計過程。

1 可編程同步二進制計數器74LS161的功能

4位MSI可編程同步二進制加法計數器74LS161的真值表如表1所示[1-2]。其中，EP、ET為計數控制端，為預置數控 制 端 ，D3、D2、D1、D0為 預 置 數 輸入端 ，為 異 步 置 零 控 制端，CP 為計數脈沖輸入端，Q3、Q2、Q1、Q0為狀態輸出端，C 為進位輸出端，“×”表示任意值。

表1 74LS161可編程度數器的真值表Tab.1 Truth table of 74LS161 programmable counter

圖1 4位二進制加法計數器74LS161的狀態圖Fig.1 The state diagram of 4-bit binary up counter 74LS161

2 基本原理及設計方法

設4位循環碼計數器的狀態輸出量為、、、，狀態圖如圖2所示。

圖2 4位循環碼計數器的狀態圖Fig.2 The state diagram of 4-bit cyclic code counter

基于可編程計數器74LS161進行循環碼計數器設計，用邏輯修改[4-5]的方法修改已有計數器的計數規律為循環碼，以74LS161已有的狀態輸出量Q3Q2Q1Q0為輸入變量定義循環碼計數器的狀態輸出量，函數關系為邏輯修改的真值表如表2所示。

表2 二進制計數修改為循環碼計數的真值表Tab.2 Truth table of binary counting code modifying to cyclic code count

圖 3 Q3′Q2′Q1′Q0′的卡諾圖及化簡Fig.3 Karnaugh map and simplification ofQ3′Q2′Q1′Q0′

3 結束語

圖4 74LS161構成循環碼計數器的邏輯圖Fig.4 Logic diagram of 74LS161 constitute a cyclic code counter

基于可編程計數器74LS161的循環碼計數器設計，提出了從現成的函數出發實現待求函數的采用MSI器件設計循環碼計數器的方法，可擴展專用集成電路的應用范圍并簡化循環碼計數的設計過程，具有實際應用意義。

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