基于MCU和CPLD的微型動態應力存儲測試系統

張海龍，馬鐵華*，謝 銳，劉雙紅

(1.中北大學儀器科學與動態測試教育部重點實驗室，太原030051;2.中北大學電子測試技術國家重點實驗室，太原030051)

基于MCU和CPLD的微型動態應力存儲測試系統

張海龍1，2，馬鐵華1，2*，謝 銳1，2，劉雙紅1，2

(1.中北大學儀器科學與動態測試教育部重點實驗室，太原030051;2.中北大學電子測試技術國家重點實驗室，太原030051)

為了解決車輛履帶上的動態應變壓力測試問題，設計了一套微型應力存儲測試系統。對于應變壓力傳感器采用電橋法測試應力并應用存儲測試技術設計了整套測試系統。使用單片機和CPLD作為系統的主控芯片完成系統的微功耗設計，并設計了模擬電路部分和數字電路部分。經過沖擊梁實驗表明此測試系統和理論計算的誤差在7%以下，可以對車輛履帶上的應力進行測量。

應力;存儲測試;微功耗;沖擊粱

在現代軍事、農業和建筑業等領域中，履帶車輛憑借其良好的性能發揮著十分重要的作用［1］。但是其工作環境惡劣，經常受到沖擊和振動，一些關重部件失效形式表現為疲勞斷裂［2］。主動輪為整車提供牽引力和制動力，承受隨機交變載荷，對其受力動態變化的過程的研究一直是業界的難點和熱點［3］。

1 應變測試基本原理

應力測試系統使用電阻應變片來測量車輛運行中的動態應變。構件上的應變片與測試系統中電阻組成電橋，構件發生形變時，引起橋臂上應變片阻值發生變化，根據胡克定律，通過測試出的構件表面測點的應變，求出測點的應力［4］。

本設計的測量電路采用惠斯登電橋，將應變片的阻值變化轉化為電壓或電流信號。基本電路如圖1所示。

圖1 惠斯登電橋測量原理

惠斯登電橋由4個電阻構成4個橋臂，A端和C端介入電源U，B端和D端為輸出端。

對電路進行分析，可得出:

其平衡條件為R1·R4=R2·R3，當電橋平衡時，橋路輸出電壓為零，電橋得到平衡。

2 存儲測試方法

單獨的單片機控制難以實現高速運行，而單獨采用CPLD控制功耗較大且邏輯復雜。在實現高速數據采樣和大容量數據存儲的功能，同時控制功耗和體積的前提下［5］。

本文設計的存儲測試方法采用單片機與CPLD共同控制的模式，使用兩片閃存交替工作組成數據存儲器。單片機控制測試系統工作狀態的轉換和發出對閃存進行寫入、讀取、擦除操作的命令，CPLD控制高速數據采樣轉換和轉換完畢后數據的緩存。這樣的設計充分利用了單片機功耗低、邏輯簡單，CPLD速度高的優點，提高了測試系統的功能性和穩定性［6］。

2.1 隨機觸發測試技術

測試系統采用的隨機觸發采樣模式，隨機觸發采樣設計為8次隨機觸發，且將Flash的存儲區域等分為8個容量相等子存儲區域，每觸發一次，就存儲一個子存儲區域，具體隨機觸發采樣狀態如圖2所示。

圖2 隨機觸發采樣狀態圖

多路待測信號輸入到測試系統的輸入信號端，應力測試系統由休眠態進入待觸發態，等待觸發信號的到來。系統進入待觸發態后，每收到一個觸發信號，測試系統的AD根據設計的采樣頻率進行數據轉換，將每次轉換的數字量寫入存儲器并保存，當子存儲空間存儲滿后，輸出第一次觸發采樣完畢信號TOFF1。當系統查詢到TOFF1信號為1時，停止采樣，等待下一次觸發信號的到來。以此類推，直到第8次觸發的子存儲空間滿后，輸出第8次觸發采樣完畢信號TOFF8。當系統查詢到TOFF8信號為1時，停止采樣，此時隨機觸發采樣過程全部完畢，應變測試系統進入待讀狀態。

2.2 大容量存儲測試技術

存儲芯片采用兩片三星公司生產的NAND型閃存存儲器K9F4G08OM，單片容量為512MB。NADA結構閃存的特點是:以頁為單位進行讀和編程操作，以塊為單位進行擦除操作［7］，對一頁(2 kbyte)數據編程進入非易失介質的典型時間為200μs，擦除一塊(128 kbyte)的時間為1.5 ms。數據、地址、命令采用同一總線，芯片使用引腳少。

由于閃存存在較長的頁編程時間，編程時無法對其進行操作，為了在高速數據轉換情況下不丟失數據，并進一步提高存儲容量，采用兩片閃存芯片交替工作組成數據存儲器，總存儲容量擴大為1 Gbyte。

2.3 多通道測試技術

測試系統需要4通道同時采集，模擬量進行1～4通道的切換，采用4通道模擬開關MAX4634，4路模擬信號每路采樣頻率為25 kHz，AD的采樣頻率為100 kHz，對應每個周期的時間為10μs。

3 系統硬件設計

本測試系統主要由以下幾部分組成:應變片，信號調理電路，電源管理電路，AD轉換器與存儲電路，控制電路，通信設備和計算機等。測試系統原理框圖如圖3所示。

圖3 測試系統原理框圖

3.1 電橋調平電路

在實際測量中，引線電阻不平衡、應變計阻值誤差以及實驗環境中溫度的變化等因素都會引起橋路微小的失衡，這些會造成橋路不平衡的因素會使應變測試電路在沒有應變輸入時對應的輸出量遠遠偏離零位，放大器本身又有零漂，這使得系統無法正常測試。因此，在模擬電路中設計了電橋調節平衡這一環節。

本系統中電橋調節芯片選用標稱值為10 kΩ的X9C103數字電位器。X9C103內部的數據電路通過開關控制中間節點在電阻網絡中的連接位置來改變電阻值，測試系統通過單片機對其輸入端口INC、U/D的值來控制電位器的移動和移動的方向。

3.2 信號調理電路

應變片產生的電壓差將由INA128儀表放大器進行放大，放大倍數計算公式為:G=1+(50 kΩ/RG)。

對經儀表放大器放大后的被測信號進行濾波處理。系統采用性能高、功耗低運放OPA4340進行低通濾波電路設計。如圖所示，圖4為濾波器電路圖。

圖4 OPA2340二階低通濾波器

3.3 A/D轉換模塊設計

測試系統選用了高速、低功耗、逐次逼近的12 bit AD轉換器AD7492.它可在2.7 V～5.25 V的電壓下工作，其數據通過率高達1 Msample/s。它內含一個低噪聲、寬頻帶的跟蹤/保持放大器，它可以處理高達10 MHz的寬頻信號。編程設置它的采樣頻率為500 kHz。使用CPLD對外部晶振分頻后的信號作為AD轉換的時鐘，這樣得到的信號穩定且占用芯片資源少。

3.4 接口電路設計

測試系統讀數設計為高速讀數。采用并行轉USB的方式將測試系統中數據并行輸出到上位機中，速度快且數據傳輸準確。

設計UART0口的 P3.4和 P3.5與上位機的TXD、RXD連接，實現測試系統與上位機讀數中斷信號的傳輸。高速讀數時將數據口、控制端與上位機的端口一一對應連接，完成數據的并行輸出。

4 系統軟件設計

4.1 單片機軟件設計

測試系統選用AVR系列單片機ATmega8515，利用匯編語言編寫。測試系統軟件方案設計主要由控制模塊對各部分模塊的控制程序組成，其中包括對信號調理模塊的控制，應變信號的采集時序，對Flash的各項操作及電源管理設計等。由于測試需求，還設計了軟件的低功耗模式和中斷機制。

系統程序總體構架如圖5所示。測試系統上電后先進行系統初始化，初始化完畢后系統進入低功耗狀態，在極功耗下等待中斷信號的到來。中斷信號發生后，系統將響應中斷信號，退出低功耗狀態，進入相應中斷，發生相應中斷的操作。系統一共設置了3個中斷，中斷1是寫中斷，中斷2是讀中斷，中斷3是擦除中斷。

圖5 單片機程序總體構架

4.2 CPLD軟件設計

CPLD采用XLINX系列芯片XCR3128，CPLD控制高速數據采樣轉換和轉換完畢后數據的緩存。AD輸出為12 bit，閃存的數據線為8 bit，轉換得到的數據先進入CPLD轉化為2組8 bit數據，使數據位數匹配

對A片發出命令后，A片進行編程時對B片寫入數據，反之相同，這樣提高了測試系統的數據處理速度，滿足了測試要求。

圖6 CPLD的狀態關系

4.3 上位機軟件的設計

上位機采用VB語言進行編程，利用測試系統要求，設計了內部1 024 Mbit數據的讀取程序。讀數時顯示界面如圖7所示。

圖7 讀數時顯示界面

點擊圖中裝置讀數，顯示讀數窗口，由讀數要求靈活選擇讀數長度，選擇讀數范圍為1～1 024。設置界面其他參數按照需要填寫。點擊開始讀數時，系統將對所選讀數長度內芯片的數據進行讀數。

5 實驗測試及結果

測試裝置采用JZT-5型多功能電子式力學綜合實驗臺的沖擊梁裝置，沖擊梁裝置配置質量塊，使質量塊自由下落，產生沖擊力［8］，把應變片貼在沖擊粱上A點處，通過測試系統，測試出瞬態動應變，求出其瞬態動應力。

根據能量守恒定律計算相應載荷動荷系數，將結構在可類比靜載荷作用下的最大應力乘以動荷系數，得到結構中的最大沖擊應力。

圖8 沖擊桿

實驗參數為:應變片電阻R=120，沖擊質量塊的質量M=200 g，等強度梁的長度L=300 mm，寬度h=15 mm，厚度b=4 mm，應變片距固定點的距離d=100 mm，支座距固定點的距離l=250 mm，彈性模量E=200 GPa，計算結果如表1所示。

表1 計算結果

測試系統的實際測量值和理論計算值的誤差結果如表2所示。

表2 實際測量值和理論計算值的誤差結果

6 結論

本文完成了對動態應力測試系統的軟硬件設計，對測試系統進行實驗和誤差分析，驗證了其合理性。與傳統測試系統相比，動態應力測試系統具有體積小，功耗低，穩定性高，抗干擾性強的優點，可實時完成對履帶車輛主動輪的應力測試，特別適宜于惡劣環境下試驗場合。

［1］藺紅軍.履帶車輛傳動系測試系統研究［D］.長春:吉林大學，2009.

［2］易當祥，劉春和，呂國志.自行火炮行動系統關重件的疲勞壽命仿真［J］.兵工學報2007，28(2):138-143.

［3］田政，陳兵，尹忠俊，等.高速履帶車輛主動輪動態應力仿真分析研究［J］.計算機仿真，2011，28(11):328-331.

［4］張浩茹，謝銳，崔冬梅.基于FPGA的應力應變測試系統設計［J］.測試技術學報，2012，26(2):158-161.

［5］王代華，宋林麗，張志杰.基于ICP傳感器的存儲式沖擊波超壓測試系統［J］.傳感技術學報，2012，25(4):478-482.

［6］陸從青，吳建輝.基于CPLD的高分辨率AD轉換電路設計［J］.電子器件，2010，33(1):62-66.

［7］謝銳，馬鐵華，裴東興.基于閃存的引信電池大容量存儲測試方法［J］.探測與控制學報，2010，32(4):34-37.

［8］謝占魁，李艷輝，謝銳.沖擊動應力實驗裝置研制［J］.中北大學學報(自然科學版)，2007，28:35-37.

M icro Dynam ic Stress Storage Measurement System Based on MCU and CPLD

ZHANG Hailong1，2，MA Tiehua1，2*，XIE Rui1，2，LIU Shuanghong1，2
(1.Key Laboratory of Instrumentation Science and Dynamic Measurement，North University of China，Taiyuan 030051，China; 2.Key Laboratory for Electronic Measurement Technology，North University of China，Taiyuan 030051，China)

A stress storagemicrosystem is introduced to slove the problem of Vehicle Track dynamic stressmeasurement.The bridgemethod is used to test stress signal collected by a strain type pressure transducer and storage testing technology is designed in thismeasurement system.With low loss MCU and CPLD asmain chips low-power of the control system is realized.Analog circuit and digital circuits are designed，The cantilever-beam impact experiment show that experimental results differ，from theoritical calculation by less than 7%.So，this system can be adopted in stressmeasurements of Vehicle track.

stress;memory test;micropower;shock beam

10.3969/j.issn.1005-9490.2014.01.029

TM 93 文獻標識碼:A 文章編號:1005-9490(2014)01-0123-04

2013-05-21修改日期:2013-06-14

EEACC:7320G

馬鐵華(1964-)男，教授，博士生導師。1996年獲哈爾濱工業大學工學博士學位1999年北京理工大學博士后出站。2002年美國路易斯安那州立大學高級訪問學者。現任中北大學信息與通信學院科研副院長、電子測試技術國防科技重點實驗室副主任。

張海龍(1988-)，男，山西臨汾人，中北大學信息與通信工程學院碩士研究生，主要研究方向動態測試，85468214 @qq.com;